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verilog always敏感列表和if条件语句
verilog always敏感列表和if条件语句
2024-11-05 21:55:24
推荐回答（1个）
回答（1）：
看你在使用freq时候用的是什么时钟，还有要确认两个信号都是时钟信号，不是时钟信号的最好不要用来做边沿触发条件
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