Verilog 判断语句

2024-11-06 07:56:16
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这个竖线不是“按位或” 而是“归约或"(Reduction or) 是单目运算符 所以只有一个操作数
可参见ieee verilog语法标准的Reduction operators小节
这里是把sramdata的8位依次进行相或运算 得到1-bit逻辑值 其实就是判断sramdata是否不为全0

这种写法(归约或及归约与)可读性较差 不如直接写等于0或1
但是归约异或有时候可以提高可读性