Verilog中如何在always block中对其他module进行调用?

2024-11-03 02:24:46
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你这完全是用软件的思维来写硬件

你有了加减乘除4个模块,你现在要做的是用一个顶层模块来例化他们,同时判断输入是加减乘除中的那个,分别送到4个模块,而不是你所说的调用

另外task几乎是不用来写综合语句的,你们老师是在坑你